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用VHDL設計實現(xiàn)的有線頂盒信源發(fā)生方案

3、系統(tǒng)整體設計
來源:投影時代 更新日期:2008-06-09 作者:佚名
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   3、系統(tǒng)整體設計

    系統(tǒng)啟動后,主機向I/O口發(fā)出地址信號。AEN為低電平時,系統(tǒng)進行地址譯碼。譯碼成功后,產(chǎn)生一使能信號ENABLE打開數(shù)據(jù)暫存單元。數(shù)據(jù)到來后,數(shù)據(jù)暫存單元將總線上的16位并行數(shù)據(jù)鎖存在暫存器中,同時產(chǎn)生一允許信號PERMIT,允許進行數(shù)據(jù)格式轉(zhuǎn)換。接下來系統(tǒng)根據(jù)當前所處的狀態(tài)進行選擇輸出,完成格式的轉(zhuǎn)換,并產(chǎn)生相應的輸出數(shù)據(jù)使能信號DEN和輸出數(shù)據(jù)時鐘信號DCLK。整個過程結(jié)束后,將各信號復位,開始新的轉(zhuǎn)換周期。因此,整個系統(tǒng)應包括五個邏輯部分:地址譯碼、數(shù)據(jù)暫存、狀態(tài)控制、復位控制、轉(zhuǎn)換輸出。

    3.1系統(tǒng)的整體框圖

    系統(tǒng)的整體框圖如圖2所示。

圖2

圖2

  3.2系統(tǒng)的工作時序

    轉(zhuǎn)換過程的時序如圖3所示。 

圖3

圖3

 

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